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Lattice Semiconductor_M5LV-512/120-7YC
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Lattice Semiconductor

M5LV-512/120-7YC  

FPGAs (Field Programmable Gate Array)
Lattice Semiconductor
M5LV-512/120-7YC
2-M5LV-512/120-7YC
CPLD MACH 5 Family 20K Gates 512 Macro Cells 83.3MHz/125MHz 3.3V 160-Pin PQFP Tray
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Beschreibung Technische Daten Unterlagen Einkaufsführer

M5LV-512/120-7YC Beschreibung

CPLD MACH 5 Family 20K Gates 512 Macro Cells 83.3MHz/125MHz 3.3V 160-Pin PQFP Tray

Technische Daten

Montageart
SMD/SMT
Verzögerungszeit
7.5 ns
Speichertyp
EEPROM
Supply Voltage - Min
3 V
Minimum Operating Temperature
0 C
Anzahl der Makrozellen
512
Verpackung/Koffer
PQFP-160
Operating Supply Voltage
3.3 V
Packaging
Tray
Number of Product Terms per Macro
32
Maximum Operating Frequency
100 MHz
Number of Programmable I/Os
48
Maximum Operating Temperature
+ 70 C
Supply Voltage - Max
3.6 V
Factory Pack Quantity
120

M5LV-512/120-7YC Unterlagen

Laden Sie Datenblätter und Herstellerdokumentation herunter für M5LV-512/120-7YC

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LC4256V75TN144-101

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