Lattice Semiconductor
M5-512/256-7SAI
FPGAs (Field Programmable Gate Array)
M5-512/256-7SAI
2-M5-512/256-7SAI
CPLD MACH 5 Family 20K Gates 512 Macro Cells 83.3MHz/125MHz 5V 352-Pin BGA Tray
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M5-512/256-7SAI Beschreibung
CPLD MACH 5 Family 20K Gates 512 Macro Cells 83.3MHz/125MHz 5V 352-Pin BGA Tray
Technische Daten
Montageart
SMD/SMT
Verzögerungszeit
7.5 ns
Speichertyp
EEPROM
Supply Voltage - Min
4.5 V
Minimum Operating Temperature
- 40℃
Anzahl der Makrozellen
512
Verpackung/Koffer
BGA-256
Operating Supply Voltage
4.5 V to 5.5 V
Packaging
Tray
Number of Product Terms per Macro
32
Maximum Operating Frequency
125 MHz, 167 MHz
Number of Programmable I/Os
256
Maximum Operating Temperature
+ 85℃
Supply Voltage - Max
5.5 V
Factory Pack Quantity
120
M5-512/256-7SAI Unterlagen
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