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Lattice Semiconductor_M4LV-128N/64-10JI
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Lattice Semiconductor

M4LV-128N/64-10JI  

FPGAs (Field Programmable Gate Array)
Lattice Semiconductor
M4LV-128N/64-10JI
2-M4LV-128N/64-10JI
CPLD MACH 4 Family 5K Gates 128 Macro Cells 71.4MHz/95.2MHz 3.3V 84-Pin PLCC Tube
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Beschreibung Technische Daten Unterlagen Einkaufsführer

M4LV-128N/64-10JI Beschreibung

CPLD MACH 4 Family 5K Gates 128 Macro Cells 71.4MHz/95.2MHz 3.3V 84-Pin PLCC Tube

Technische Daten

Montageart
SMD/SMT
Verzögerungszeit
10 ns
Speichertyp
EEPROM
Supply Voltage - Min
3 V
Minimum Operating Temperature
- 40℃
Anzahl der Makrozellen
128
Verpackung/Koffer
PLCC-84
Operating Supply Voltage
4.5 V to 5.5 V
Packaging
Tube
Number of Product Terms per Macro
20
Maximum Operating Frequency
111.1 MHz
Number of Programmable I/Os
64
Maximum Operating Temperature
+ 85℃
Supply Voltage - Max
3.6 V
Factory Pack Quantity
450

M4LV-128N/64-10JI Unterlagen

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