Lattice Semiconductor
M4LV-128/64-7YC
FPGAs (Field Programmable Gate Array)
M4LV-128/64-7YC
2-M4LV-128/64-7YC
CPLD MACH 4 Family 5K Gates 128 Macro Cells 90.9MHz/111.1MHz 3.3V 100-Pin PQFP Tray
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M4LV-128/64-7YC Beschreibung
CPLD MACH 4 Family 5K Gates 128 Macro Cells 90.9MHz/111.1MHz 3.3V 100-Pin PQFP Tray
Technische Daten
Montageart
SMD/SMT
Verzögerungszeit
7.5 ns
Speichertyp
EEPROM
Supply Voltage - Min
3 V
Minimum Operating Temperature
0 C
Anzahl der Makrozellen
128
Verpackung/Koffer
PQFP-100
Operating Supply Voltage
4.75 V to 5.25 V
Packaging
Tube
Number of Product Terms per Macro
20
Maximum Operating Frequency
111.1 MHz
Number of Programmable I/Os
64
Maximum Operating Temperature
+ 70 C
Supply Voltage - Max
3.6 V
Factory Pack Quantity
66
M4LV-128/64-7YC Unterlagen
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