Lattice Semiconductor
GAL20VP8B-25LP
FPGAs (Field Programmable Gate Array)
GAL20VP8B-25LP
2-GAL20VP8B-25LP
SPLD GAL Family 8 Macro Cells 50MHz 5V 24-Pin PDIP
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Technische Daten
Montageart
Through Hole
Betriebstemperatur
0 C to + 75 C
Versorgungsstrom
115 mA
Verzögerungszeit
25 ns
Supply Voltage - Min
4.75 V
Minimum Operating Temperature
0 C
Anzahl der Makrozellen
8
Verpackung/Koffer
PDIP-24
Operating Supply Voltage
4.75 V to 5.25 V
Number of Product Terms per Macro
8
Maximum Operating Frequency
50 MHz
Maximum Operating Temperature
+ 75 C
Logic Family
GAL
Supply Voltage - Max
5.25 V
Factory Pack Quantity
15
GAL20VP8B-25LP Unterlagen
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